Microchip, dsPIC33AK512MPS506T-I/PT 数字信号处理器 (DSP), 单线, 16 位, 32 位, 双精度浮点运算单元DSP, dsPIC33A系列, 16 bit, 64引脚, TQFP封装, 64 kB
- RS 库存编号:
- 636-210
- 制造商零件编号:
- dsPIC33AK512MPS506T-I/PT
- 制造商:
- Microchip
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单位 | 每单位 | 每卷* |
|---|---|---|
| 1500 + | RMB26.545 | RMB39,817.50 |
* 参考价格
- RS 库存编号:
- 636-210
- 制造商零件编号:
- dsPIC33AK512MPS506T-I/PT
- 制造商:
- Microchip
产品技术参数
产品技术参数资料
法例与合规
产品详细信息
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选择全部 | 属性 | 值 |
|---|---|---|
| 品牌 | Microchip | |
| 最高时钟频率 | 200MHz | |
| 产品类型 | 数字信号处理器 (DSP) | |
| 系列 | dsPIC33A | |
| 装置备每秒百万条指令 | 200MIPS | |
| 数据总线宽度 | 16bit | |
| 内存大小 | 64kB | |
| 指令集结构 | CISC, DSP | |
| 芯 | dsPIC33 | |
| 程序存储器大小 | 512kB | |
| 程序存储器类型 | 闪存 | |
| 最低电源电压 | 3V | |
| 数字式和算术格式 | 单线, 16 位, 32 位, 双精度浮点运算单元 | |
| 最大电源电压 | 3.6V | |
| 安装类型 | 表面 | |
| 包装类型 | TQFP | |
| 模数转换器数目 | 5 | |
| PWM 通道数目 | 16 | |
| 最低工作温度 | -40°C | |
| 引脚数目 | 64 | |
| 最高工作温度 | 150°C | |
| 标准/认证 | ISO 26262 - ASIL B, IEC 61508 SIL 2, IEC 60730 Class B, AEC-Q100 REV-H | |
| 模数转换器通道 | 16 | |
| 计时器数目 | 11 | |
| PWM分辨率 | 78ps | |
| 汽车标准 | AEC-Q100 Rev H, AEC-Q100 修订版 H 2 级, AEC-Q100 修订版 H 1 级 | |
| 模数转换器分辨率 | 12bit | |
| 芯数 | 1 | |
| PWM单元数目 | 8 | |
| 选择全部 | ||
|---|---|---|
品牌 Microchip | ||
最高时钟频率 200MHz | ||
产品类型 数字信号处理器 (DSP) | ||
系列 dsPIC33A | ||
装置备每秒百万条指令 200MIPS | ||
数据总线宽度 16bit | ||
内存大小 64kB | ||
指令集结构 CISC, DSP | ||
芯 dsPIC33 | ||
程序存储器大小 512kB | ||
程序存储器类型 闪存 | ||
最低电源电压 3V | ||
数字式和算术格式 单线, 16 位, 32 位, 双精度浮点运算单元 | ||
最大电源电压 3.6V | ||
安装类型 表面 | ||
包装类型 TQFP | ||
模数转换器数目 5 | ||
PWM 通道数目 16 | ||
最低工作温度 -40°C | ||
引脚数目 64 | ||
最高工作温度 150°C | ||
标准/认证 ISO 26262 - ASIL B, IEC 61508 SIL 2, IEC 60730 Class B, AEC-Q100 REV-H | ||
模数转换器通道 16 | ||
计时器数目 11 | ||
PWM分辨率 78ps | ||
汽车标准 AEC-Q100 Rev H, AEC-Q100 修订版 H 2 级, AEC-Q100 修订版 H 1 级 | ||
模数转换器分辨率 12bit | ||
芯数 1 | ||
PWM单元数目 8 | ||
- COO (Country of Origin):
- TH
Microchip 数字信号控制器 (DSC),带 32/64 位浮点装置 (FPU) 和高达 512KB 闪存程序存储器和 64KB SRAM 数据存储器。高速 40MSPS 12 位 ADC、具有低输入电压偏移的高带宽 100MHz 运算放大器、快速 5nS 比较器和高速 PWM 输出，旨在优化实时控制应用。该系列设计符合 ISO 26262 和 IEC 61508 功能安全标准,提供芯片上的安全功能和 AEC-Q100 认证支持。
32 位宽数据路径
单和双精密浮点装置 (FPU) 合处理器
I/O 引脚上的边缘或电平变化通知中断
外围引脚选择可重构引脚,以减少板布局复杂性
多个中断矢量,具有单独可编程优先级
五个外部中断引脚